研究同构/异构多芯粒系统的缓存一致性机制,探索集成芯片的多级缓存架构、可扩展的存储管理机制以及基于片上网络的访存优化策略。构建芯粒间的缓存一致性访存行为级模型,支持256核以上规模的CC-NUMA架构,典型延迟低于100ns,并开源功能验证模拟器。 4. 面向万瓦级集成芯片的供电架构与电路。 研究高功率密度集成供电架构和电路,探索面向万瓦级集成芯片的多级、低损耗供电架构。...
针对生成式人工智能中的智能涌现、情景学习、指令微调以及思维链等能力,设计有效分析工具以探索其数理机理,并在此基础上进一步提升模型的泛化性、多步推理及复杂任务分解等能力。 (二)面向生成式模型的新型高效神经网络架构研究。 ...
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