IEC 62530-2:2023-10 (IEEE Std 1800.2-2020)

IEEE/IEC International Standard--SystemVerilog--Part 2: Universal Verification Methodology Language Reference Manual

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标准号

IEC 62530-2:2023-10 (IEEE Std 1800.2-2020)

发布

2023年

发布单位

美国电气电子工程师学会

 

 

适用范围

The Universal Verification Methodology (UVM) that can improve interoperability, reduce the cost of using intellectual property (IP) for new projects or electronic design automation (EDA) tools, and make it easier to reuse verification components is provided. Overall, using this standard will lower verification costs and improve design quality throughout the industry. The primary audiences for this...

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