IEEE P1800/D6, August 2012
IEEE 批准的系统 Verilog 标准草案——统一硬件设计、规范和验证语言

IEEE Approved Draft Standard for System Verilog--Unified Hardware Design, Specification, and Verification Language


 

 

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标准号
IEEE P1800/D6, August 2012
发布
2012年
发布单位
美国电气电子工程师学会
 
 
适用范围
该标准是两个先前标准的合并：IEEE Std 1364-2005 Verilog 硬件描述语言 (HDL) 和 IEEE Std 1800-2005 SystemVerilog 统一硬件设计、规范和验证语言。 2005 SystemVerilog 标准定义了 2005 Verilog 标准的扩展。这两个标准旨在用作一种语言。合并基础 Verilog 语言...

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