ANSI/IEEE 1800:2009
系统Verilog语言标准.统一硬件设计,规范和鉴定语言

Standard for SystemVerilog - Unified Hardware Design, Specification, and Verification Language

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标准号: ANSI/IEEE 1800:2009
发布: 2009年
发布单位: 美国国家标准学会
当前最新: ANSI/IEEE 1800:2009

适用范围: 该项目的目的是为 EDA、半导体和系统设计社区提供可靠且定义明确的统一硬件设计、规范和验证标准语言。

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