IEEE P1800/D4a, July 2017
IEEE SystemVerilog 标准草案——统一硬件设计、规范和验证语言

IEEE Draft Standard for SystemVerilog--Unified Hardware Design, Specification, and Verification Language

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标准号: IEEE P1800/D4a, July 2017
发布: 2017年
发布单位: 美国电气电子工程师学会

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